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超大規(guī)模集成電路分析與設(shè)計(jì)
《超大規(guī)模集成電路分析與設(shè)計(jì)》是在學(xué)生對(duì)CMOS邏輯電路有一定了解的基礎(chǔ)上,討論CMOS VLSI電路的原理與設(shè)計(jì)。首先介紹CMOS VLSI電路發(fā)展的基本理論----scaling down理論,分析器件特征尺寸減小對(duì)CMOS VLSI電路的影響,以及CMOS VLSI電路中互連線的寄生效應(yīng)和影響。全書(shū)重點(diǎn)是分析構(gòu)成數(shù)字系統(tǒng)的存儲(chǔ)器、運(yùn)算器和控制器的結(jié)構(gòu)、電路工作原理和設(shè)計(jì)考慮。然后討論CMOS VLSI電路和版圖的設(shè)計(jì)方法,重點(diǎn)講解全定制和半定制設(shè)計(jì)方法。最后,對(duì)CMOS與Bipolar相結(jié)合構(gòu)成的BiCMOS電路做一個(gè)簡(jiǎn)單介紹。
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