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Verilog HDL數(shù)字設(shè)計與綜合(第二版)(本科教學(xué)版)

Verilog HDL數(shù)字設(shè)計與綜合(第二版)(本科教學(xué)版)

定  價:59 元

叢書名:國外電子與通信教材系列

        

  • 作者:(美) Samir Palnitkar (薩米爾 · 帕爾尼卡)
  • 出版時間:2022/1/1
  • ISBN:9787121427732
  • 出 版 社:電子工業(yè)出版社
  • 中圖法分類:TN702.2 
  • 頁碼:308
  • 紙張:
  • 版次:01
  • 開本:16開
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讀者對象:本書適合電子、計算機、自動控制等專業(yè)的學(xué)習(xí)數(shù)字電路設(shè)計的大學(xué)本科高年級學(xué)生閱讀,也適合數(shù)字系統(tǒng)設(shè)計工程師和已具有多年Verilog設(shè)計工作經(jīng)驗的資深工程師參考。

本書從用戶的角度全面闡述了Verilog HDL語言的重要細節(jié)和基本設(shè)計方法,并詳細介紹了Verilog 2001版的主要改進部分。本書重點關(guān)注如何應(yīng)用Verilog語言進行數(shù)字電路和系統(tǒng)的設(shè)計和驗證,而不僅僅講解語法。全書從基本概念講起,并逐漸過渡到編程語言接口以及邏輯綜合等高級主題。書中的內(nèi)容全部符合Verilog HDL IEEE 1364-2001標準。
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